看了PCI-CAN總線文檔發(fā)現(xiàn)這個邏輯 ● ALE = /SA0 · /IOP_WR ● WR = SA0 · /IOP_WR 是不是有問題?? SA0為0的時候,ALE=1,WR=0 SA0為1的時候,ALE=0,WR=1 WR=1 CAN 如何能夠進(jìn)行讀寫呢??
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看了PCI-CAN總線文檔發(fā)現(xiàn)這個邏輯 ● ALE = /SA0 · /IOP_WR ● WR = SA0 · /IOP_WR 是不是有問題?? SA0為0的時候,ALE=1,WR=0 SA0為1的時候,ALE=0,WR=1 WR=1 CAN 如何能夠進(jìn)行讀寫呢??
您看錯了.... /WR = SA0 · /IOP_WR
我覺得這個表達(dá)有問題 應(yīng)該這么理解 TOP_WR和SA0經(jīng)過FPGA譯碼,當(dāng)SA0為0時,ALE為高電平,/WR為高電平 當(dāng)SA0為1時,ALE為低電平,/WR為低電平
當(dāng)SA0為0時,WR是高電平,也就是/WR是低電平....