用示波器測ＷＲ，ＲＤ引腳，當ＷＲ引腳低電平時，ＲＤ引腳整體高電平，但有兩個明顯的低電瓶，造成讀寫沖突？ 請問可能原因出在那里？？？
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通用Ｉ／Ｏ模擬并口時續(xù)
你用的總線方式還是模擬I/O口方式，按照你說的，如果是總線方式的話，你需要查下和RD引腳連接的芯片會不會把你的RD引腳拉低，如果是模擬I/O口的話，除了上面說的，還有就是你的軟件上面會不會存在問題
用的模擬I/O，前段用中檔單片機做（ＳＰＩ）成功；現(xiàn)在ＤＳＰ！ 而且出現(xiàn)軟件復位現(xiàn)象?。?！ 程序主要用的是你們的，做了一些修改?。∵B線應該不會出問題！
？？
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